quartus中進行模擬時，視窗沒有波形圖的幾種可能
在quartus中寫完程式碼，為了驗證我們寫的是否正確，一般都需要編寫test bench指令碼進行模擬，但是由於我的粗心，老是出現視窗啥也沒有的情況，大概總結了有以下幾種情況。
1、我們在test bench中例化的模組沒有設定成頂層檔案
2、例化模組時，忘記給這個模組取個名字
3、test bench中沒有寫時間 `timescale 1ns/1ns
4、如果編譯通過了，模擬時遇到Error: E:/intelFPGA/18.0/modelsim_ase/win32aloem/vlog failed.這種情況大部分原因是程式碼中，變數的使用在其宣告之前！切記：一定要宣告變數之後再使用，否則，模擬就會報這種錯誤，我在這個問題上花了2小時才知道的。
目前就發現這幾種情況。
如果模擬彈出這樣的框，說明你已經開了一個模擬視窗，先關掉之前的視窗，就可以進行目前的模擬操作了
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