訊號完整性設計在產品開發中越來越受到重視，而訊號完整性的測試手段種類繁多，有頻域，也有時域的，還有一些綜合性的手段，比如誤碼測試。這些手段並非任何情況下都適合使用，都存在這樣那樣的侷限性，合適選用，可以做到事半功倍，避免走彎路。本文對各種測試手段進行介紹，並結合實際硬體開發活動說明如何選用。

訊號完整性的測試手段很多，涉及的儀器也很多，因此熟悉各種測試手段的特點，以及根據測試物件的特性和要求，選用適當的測試手段，對於選擇方案、驗證效果、解決問題等硬體開發活動，都能夠大大提高效率，起到事半功倍的作用。

訊號完整性的測試手段

早期的時候，訊號完整性分析的手段不多，但是時至今日，訊號完整性分析的手段越來越多，不管是時域的還是頻域的，不管是波形還是眼圖，亦或是誤位元速率等等，只要你想要的，不久的將來各大廠商都能設計的出來。雖然現在有很多測試手段，但是這些手段既有優點，也存在侷限性，實際上不可能全部都使用，下面對這些手段進行一些說明。

1. 波形測試

波形測試是訊號完整性測試中最常用的手段，一般是使用示波器進行，主要測試波形幅度、邊沿和毛刺等，通過測試波形的引數，可以看出幅度、邊沿時間等是否滿足器件介面電平的要求，有沒有存在訊號毛刺等。由於示波器是極為通用的儀器，幾乎所有的硬體工程師都會使用，但並不表示大家都使用得好。波形測試也要遵循一些要求，才能夠得到準確的訊號。

首先是要求主機和探頭一起組成的頻寬要足夠。基本上測試系統（一定要注意這是講的是系統）的頻寬是測試訊號頻寬的3倍以上就可以了。實際使用中，有一些工程師隨便找一些探頭就去測試，甚至是K公司的探頭插到T公司的示波器去，這種測試很難得到準確的結果。

其次要注重細節。比如測試點通常選擇放在接收器件的管腳，如果條件限制放不到上面去的，比如BGA封裝的器件，可以放到最靠近管腳的PCB走線上或者過孔上面。距離接收器件管腳過遠，因為訊號反射，可能會導致測試結果和實際訊號差異比較大；探頭的地線儘量選擇短地線等。

最後，需要注意一下匹配。這個主要是針對使用同軸電纜去測試的情況，同軸直接接到示波器上去，負載通常是50歐姆，並且是直流耦合，而對於某些電路，需要直流偏置，直接將測試系統接入時會影響電路工作狀態，從而測試不到正常的波形。

2. 眼圖測試

眼圖測試是常用的測試手段，特別是對於有規範要求的介面，比如USB、Ethernet、SATA、HDMI，還有光介面等。這些標準介面訊號的眼圖測試，主要是用帶MASK(模板)的示波器，包括通用示波器，取樣示波器或者訊號分析儀，這些示波器內建的時鐘提取功能，可以顯示眼圖，對於沒有MASK的示波器，可以使用外接時鐘進行觸發。使用眼圖測試功能，需要注意測試波形的數量，特別是對於判斷介面眼圖是否符合規範時，數量過少，波形的抖動比較小，也許有一下違規的情況，比如波形進入MASK的某部部分，就可能採集不到，出現誤判為通過，數量太多，會導致整個測試時間過長，效率不高，通常情況下，測試波形數量不少於2000，在3000左右為適宜。

目前有一些儀器，利用分析軟體，可以對眼圖中的違規詳細情況進行檢視，比如在MASK中落入了一些取樣點，在以前是不知道哪些情況下落入的，因為所有的取樣點是累加進去的，總的效果看起來就象是長餘暉顯示。而新的儀器，利用了其長儲存的優勢，將波形採集進來後進行處理顯示，因此波形的每一個細節都可以保留，因此它可以檢視波形的違規情況，比如波形是000010還是101010，這個功能可以幫助硬體工程師查詢問題的根源所在。

3. 抖動測試

抖動測試現在越來越受到重視，因為專用的抖動測試儀器，比如TIA(時間間隔分析儀)、SIA3000，價格非常昂貴，使用得比較少。使用得最多是示波器加上軟體處理，如keysight的EZJIT，TEK的DPOJitter軟體。通過軟體處理，分離出各個分量，比如RJ和DJ，以及DJ中的各個分量。對於這種測試，選擇的示波器，長儲存和高速取樣是必要條件，比如2M以上的儲存器，20GSa/s的取樣速率。不過目前抖動測試，各個公司的解決方案得到結果還有相當差異，還沒有哪個是權威或者行業標準。

4. TDR測試

TDR測試目前主要使用於PCB(印製電路板)訊號線、以及器件阻抗的測試，比如單端訊號線，差分訊號線，聯結器線纜等。這種測試有一個要求，就是和實際應用的條件相結合，比如實際該訊號線的訊號上升沿在300ps左右，那麼TDR的輸出脈衝訊號的上升沿也要相應設定在300ps附近，而不使用30ps左右的上升沿，否則測試結果可能和實際應用有比較大的差別。影響TDR測試精度有很多的原因，主要有反射、校準、讀數選擇等，反射會導致較短的PCB訊號線測試值出現嚴重偏差，特別是在使用TIP(探針)去測試的情況下更為明顯，因為TIP和訊號線接觸點會導致很大的阻抗不連續，導致反射發生，並導致附近三、四英寸左右範圍的PCB訊號線的阻抗曲線起伏。

5. 時序測試

現在器件的工作速率越來越快，時序容限越來越小，時序問題導致產品不穩定是非常常見的，因此時序測試是非常必要的。測試時序通常需要多通道的示波器和多個探頭，示波器的邏輯觸發或者碼型和狀態觸發功能，對於快速捕獲到需要的波形，很有幫助，不過多個探頭在實際操作中，並不容易，又要拿探頭，又要操作示波器，那個時候感覺有孫悟空的三頭六臂就方便多了。邏輯分析儀用做時序測試並不多，因為它主要作用是分析碼型，也就是分析訊號線上跑的是什麼碼，和程式碼聯絡在一起，可以分析是哪些指令或者資料。在對於要求不高的情況下，可以用它來測試，它相對示波器來說，優勢就是通道數多，但是它的劣勢是探頭連線困難，除非設計的時候就已經考慮了連線問題，否則飛線就是唯一的選擇，如果訊號線在PCB的內層，幾乎很難做到。

6. 頻譜測試

對於產品的開發前期，這種測試應用相對比較少，但是對於後期的系統測試，比如EMC測試，很多產品都需要測試。通過該測試發現某些頻點超標，然後可以使用近場掃描器(其中關鍵的儀器是頻譜儀)，例如EMCSCANER，來分析板卡上面具體哪一部分的頻譜比較高，從而找出超標的根源所在。不過這些裝置相對都比較昂貴，中小公司擁有的不多，因此通常情況下都是在設計時仔細做好匹配和遮蔽，避免後面測試時發現訊號頻譜超標，因為後期發現了問題，很多情況下是很難定位的。

7. 頻域阻抗測試

現在很多標準介面，比如E1/T1等，為了避免有太多的能量反射，都要求比較好地匹配，另外在射頻或者微波，相互對接，對阻抗通常都有要求。這些情況下，都需要進行頻域的阻抗測試。阻抗測試通常使用網路分析儀，單端埠相對簡單，對於差分輸入的埠，可以使用Balun進行差分和單端轉換。

8. 傳輸線損耗測試

傳輸線損耗測試，對於長的PCB走線，或者電纜等，在傳輸距離比較遠，或者傳輸訊號速率非常高的情況下，還有頻域的串擾等，都可以使用網路分析儀來測試。同樣的，對於PCB差分訊號或者雙絞線，也可是使用Balun進行差分到單端轉換，或者使用4埠網路分析來測試。多埠網路分析儀的校準，使用電子校準件可以大大提高校準的效率。

9. 誤碼測試

誤碼測試實際上是系統測試，利用誤碼儀，甚至是一些軟體都可做，比如可以通過兩臺電腦，使用軟體，測試連線兩臺電腦間的網路誤碼情況。誤碼測試可以對資料的每一位都進行測試，這是它的優點，相比之下示波器只是部分時間進行取樣，很多時間都在等待，因此漏過了很多細節。低誤位元速率的裝置的誤碼測試很耗費時間，有的測試時間是一整天，甚至是數天。

實際中如何選用這上述測試手段，需要根據被測試物件進行具體分析，不同的情況需要不同的測試手段。比如有標準介面的，就可以使用眼圖測試、阻抗測試和誤碼測試等，對於普通硬體電路，可以使用波形測試、時序測試，設計中有高速訊號線，還可以使用TDR測試。對於時鐘、高速序列訊號，還可以抖動測試等。

另外上面眾多的儀器，很多都可以實現多種測試，比如示波器，可以實現波形測試，時序測試，眼圖測試和抖動測試等，網路分析儀可以實現頻域阻抗測試、傳輸損耗測試等，因此靈活應用儀器也是提高測試效率，發現設計中存在問題的關鍵。

訊號完整性模擬

訊號完整性測試是訊號完整性設計的一個手段，在實際應用中還有訊號完整性模擬，這兩個手段結合在一起，為硬體開發活動提供了強大的支援。

在需求分析和方案選擇階段，就可以應用一些訊號完整性測試手段和模擬手段來分析可行性，或者判斷哪種方案優勝，比如測試一些關鍵晶片的評估板，看看訊號的電平、速率等是否滿足要求，或者利用事先得到的器件模型，進行模擬，看介面的訊號傳輸距離是否滿足要求等。在平時利用測試手段，也可以得到一些器件的模型，比如電纜的傳輸模型，這種模型可以利用在模擬中，當這些模型積累比較多，一些部分測試，包括設計完畢後的驗證測試，可以用模擬來替代，這對於效率提高很有好處，因為一個設計中的所有的訊號都完全進行測試，是比較困難的，也是很耗費時間的。

在設計階段，通常是使用模擬手段，對具體問題進行分析，比如負載的個數，PCB訊號線的拓撲結構，並根據模擬結果對設計進行調整，以便將大多數的訊號完整性問題解決在設計階段。

系統除錯以及驗證測試階段，主要是利用訊號完整性測試手段，對設計進行測試，看是否設計的要求。如果發現了嚴重問題，就要去解決，訊號完整性的測試和模擬手段都將用來尋找問題的根源，以及尋找適合的解決方案上面。

訊號完整性測試和訊號完整性模擬緊密結合，這是訊號完整性設計的基本要求，但是現在很多公司在這一塊上面都存在很多的問題，有的只有測試，有的則只依賴於模擬，當然，這些歸根結底還是因為財力和人力的不充足。